/*************************************************************************** * __________ __ ___. * Open \______ \ ____ ____ | | _\_ |__ _______ ___ * Source | _// _ \_/ ___\| |/ /| __ \ / _ \ \/ / * Jukebox | | ( <_> ) \___| < | \_\ ( <_> > < < * Firmware |____|_ /\____/ \___ >__|_ \|___ /\____/__/\_ \ * \/ \/ \/ \/ \/ * * Copyright (C) 2007 by Karl Kurbjun * Copyright (C) 2008 by Maurus Cuelenaere * * This program is free software; you can redistribute it and/or * modify it under the terms of the GNU General Public License * as published by the Free Software Foundation; either version 2 * of the License, or (at your option) any later version. * * This software is distributed on an "AS IS" basis, WITHOUT WARRANTY OF ANY * KIND, either express or implied. * ****************************************************************************/ /** All register offset definitions for the TI DM320 * Taken from: http://svn.neurostechnology.com/filedetails.php?repname=neuros-bsp&path=%2Ftrunk%2Fkernels%2Flinux-2.6.15%2Finclude%2Fasm-arm%2Farch-ntosd-dm320%2Fio_registers.h&rev=0&sc=0 */ #ifndef __DM320_H__ #define __DM320_H__ #if !defined(__ASSEMBLER__) && !defined(__LD__) /* These variables are created during linking (app/boot.lds) */ extern unsigned long _lcdbuf; #ifdef MROBE_500 extern unsigned long _lcdbuf2; #endif extern unsigned long _ttbstart; #endif /* See https://www.heyrick.co.uk/blog/files/datasheets/tms320dm320part1.pdf */ #define CACHEALIGN_BITS 5 #define CACHEALIGN_SIZE 32 #define TTB_BASE_ADDR (_ttbstart) /* End of memory */ #define FRAME ((short *) (&_lcdbuf)) /* Right after TTB */ #ifdef MROBE_500 #define FRAME2 ((short *) (&_lcdbuf2)) /* Right after FRAME */ #endif #ifndef LCD_NATIVE_WIDTH #define LCD_NATIVE_WIDTH LCD_WIDTH #endif #ifndef LCD_NATIVE_HEIGHT #define LCD_NATIVE_HEIGHT LCD_HEIGHT #endif /* must be 16Kb (0x4000) aligned */ #define TTB_SIZE (0x4000) #ifdef MROBE_500 /* Give this 1 meg to allow it to align to the MMU boundary */ #define LCD_FUDGE (LCD_NATIVE_WIDTH%32) #define LCD_BUFFER_SIZE ((LCD_NATIVE_WIDTH+LCD_FUDGE)*LCD_NATIVE_HEIGHT*2) #define LCD_TTB_AREA (0x100000*((LCD_BUFFER_SIZE>>19)+1)) #else #define LCD_BUFFER_SIZE (LCD_NATIVE_WIDTH*LCD_NATIVE_HEIGHT*2) #define LCD_TTB_AREA (TTB_SIZE + LCD_BUFFER_SIZE) #endif #define PHY_IO_BASE 0x00030000 #define DM320_REG(addr) (*(volatile unsigned short *)(PHY_IO_BASE + (addr))) #define PHY_IO_BASE2 0x00060000 #define DM320_REG2(addr) (*(volatile unsigned int *)(PHY_IO_BASE2 + (addr))) #define COP_IO_BASE 0x00090000 #define DM320_COP(addr) (*(volatile unsigned short *)(COP_IO_BASE + (addr))) /* This needs to be 2048 byte aligned, but USB_QHARRAY_ATTR should take care * of that */ #define USB_QHARRAY_ATTR __attribute__((section(".qharray"),nocommon,aligned(4))) #define USB_DEVBSS_ATTR IBSS_ATTR /* Timer 0-3 */ #define IO_TIMER0_TMMD DM320_REG(0x0000) #define IO_TIMER0_TMRSV0 DM320_REG(0x0002) #define IO_TIMER0_TMPRSCL DM320_REG(0x0004) #define IO_TIMER0_TMDIV DM320_REG(0x0006) #define IO_TIMER0_TMTRG DM320_REG(0x0008) #define IO_TIMER0_TMCNT DM320_REG(0x000A) #define IO_TIMER1_TMMD DM320_REG(0x0080) #define IO_TIMER1_TMRSV0 DM320_REG(0x0082) #define IO_TIMER1_TMPRSCL DM320_REG(0x0084) #define IO_TIMER1_TMDIV DM320_REG(0x0086) #define IO_TIMER1_TMTRG DM320_REG(0x0088) #define IO_TIMER1_TMCNT DM320_REG(0x008A) #define IO_TIMER2_TMMD DM320_REG(0x0100) #define IO_TIMER2_TMVDCLR DM320_REG(0x0102) #define IO_TIMER2_TMPRSCL DM320_REG(0x0104) #define IO_TIMER2_TMDIV DM320_REG(0x0106) #define IO_TIMER2_TMTRG DM320_REG(0x0108) #define IO_TIMER2_TMCNT DM320_REG(0x010A) #define IO_TIMER3_TMMD DM320_REG(0x0180) #define IO_TIMER3_TMVDCLR DM320_REG(0x0182) #define IO_TIMER3_TMPRSCL DM320_REG(0x0184) #define IO_TIMER3_TMDIV DM320_REG(0x0186) #define IO_TIMER3_TMTRG DM320_REG(0x0188) #define IO_TIMER3_TMCNT DM320_REG(0x018A) /* Serial 0/1 */ #define IO_SERIAL0_TX_DATA DM320_REG(0x0200) #define IO_SERIAL0_RX_DATA DM320_REG(0x0202) #define IO_SERIAL0_TX_ENABLE DM320_REG(0x0204) #define IO_SERIAL0_MODE DM320_REG(0x0206) #define IO_SERIAL0_DMA_TRIGGER DM320_REG(0x0208) #define IO_SERIAL0_DMA_MODE DM320_REG(0x020A) #define IO_SERIAL0_DMA_SDRAM_LOW DM320_REG(0x020C) #define IO_SERIAL0_DMA_SDRAM_HI DM320_REG(0x020E) #define IO_SERIAL0_DMA_STATUS DM320_REG(0x0210) #define IO_SERIAL1_TX_DATA DM320_REG(0x0280) #define IO_SERIAL1_RX_DATA DM320_REG(0x0282) #define IO_SERIAL1_TX_ENABLE DM320_REG(0x0284) #define IO_SERIAL1_MODE DM320_REG(0x0286) /* UART 0/1 */ #define IO_UART0_DTRR DM320_REG(0x0300) #define IO_UART0_BRSR DM320_REG(0x0302) #define IO_UART0_MSR DM320_REG(0x0304) #define IO_UART0_RFCR DM320_REG(0x0306) #define IO_UART0_TFCR DM320_REG(0x0308) #define IO_UART0_LCR DM320_REG(0x030A) #define IO_UART0_SR DM320_REG(0x030C) #define IO_UART1_DTRR DM320_REG(0x0380) #define IO_UART1_BRSR DM320_REG(0x0382) #define IO_UART1_MSR DM320_REG(0x0384) #define IO_UART1_RFCR DM320_REG(0x0386) #define IO_UART1_TFCR DM320_REG(0x0388) #define IO_UART1_LCR DM320_REG(0x038A) #define IO_UART1_SR DM320_REG(0x038C) /* Watchdog Timer */ #define IO_WATCHDOG_MODE DM320_REG(0x0400) #define IO_WATCHDOG_RESET DM320_REG(0x0402) #define IO_WATCHDOG_PRESCALAR DM320_REG(0x0404) #define IO_WATCHDOG_DIVISOR DM320_REG(0x0406) #define IO_WATCHDOG_EXT_RESET DM320_REG(0x0408) /* MMC/SD Controller */ #define IO_MMC_CONTROL DM320_REG(0x0480) #define IO_MMC_MEM_CLK_CONTROL DM320_REG(0x0482) #define IO_MMC_STATUS0 DM320_REG(0x0484) #define IO_MMC_STATUS1 DM320_REG(0x0486) #define IO_MMC_INT_ENABLE DM320_REG(0x0488) #define IO_MMC_RESPONSE_TIMEOUT DM320_REG(0x048A) #define IO_MMC_READ_TIMEOUT DM320_REG(0x048C) #define IO_MMC_BLOCK_LENGTH DM320_REG(0x048E) #define IO_MMC_NR_BLOCKS DM320_REG(0x0490) #define IO_MMC_NR_BLOCKS_COUNT DM320_REG(0x0492) #define IO_MMC_RX_DATA DM320_REG(0x0494) #define IO_MMC_TX_DATA DM320_REG(0x0496) #define IO_MMC_COMMAND DM320_REG(0x0498) #define IO_MMC_ARG_LOW DM320_REG(0x049A) #define IO_MMC_ARG_HI DM320_REG(0x049C) #define IO_MMC_RESPONSE0 DM320_REG(0x049E) #define IO_MMC_RESPONSE1 DM320_REG(0x04A0) #define IO_MMC_RESPONSE2 DM320_REG(0x04A2) #define IO_MMC_RESPONSE3 DM320_REG(0x04A4) #define IO_MMC_RESPONSE4 DM320_REG(0x04A6) #define IO_MMC_RESPONSE5 DM320_REG(0x04A8) #define IO_MMC_RESPONSE6 DM320_REG(0x04AA) #define IO_MMC_RESPONSE7 DM320_REG(0x04AC) #define IO_MMC_SPI_DATA DM320_REG(0x04AE) #define IO_MMC_SPI_ERR DM320_REG(0x04B0) #define IO_MMC_COMMAND_INDEX DM320_REG(0x04B2) #define IO_MMC_CLK_START_PHASE DM320_REG(0x04B4) #define IO_MMC_RESPONSE_TOUT_CNT DM320_REG(0x04B6) #define IO_MMC_READ_TOUT_CNT DM320_REG(0x04B8) #define IO_MMC_BLOCK_LENGTH_CNT DM320_REG(0x04BA) #define IO_MMC_SD_DMA_TRIGGER DM320_REG(0x04BC) #define IO_MMC_SD_DMA_MODE DM320_REG(0x04BE) #define IO_MMC_SD_DMA_ADDR_LOW DM320_REG(0x04C0) #define IO_MMC_SD_DMA_ADDR_HI DM320_REG(0x04C2) #define IO_MMC_SD_DMA_STATUS0 DM320_REG(0x04C4) #define IO_MMC_SD_DMA_STATUS1 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IO_MEM_STICK_DMA_MODE DM320_REG(0x0C90) #define IO_MEM_STICK_SDRAM_ADDL DM320_REG(0x0C92) #define IO_MEM_STICK_SDRAM_ADDH DM320_REG(0x0C94) #define IO_MEM_STICK_DMA_STATUS DM320_REG(0x0C96) /* ATM : WBB Need to find these Register values */ #define IO_ATM_ DM320_REG(0x0D00) /* I2C */ #define IO_I2C_TXDATA DM320_REG(0x0D80) #define IO_I2C_RXDATA DM320_REG(0x0D82) #define IO_I2C_SCS DM320_REG(0x0D84) /* VLYNQ */ #define VL_ID DM320_REG2(0x0300) #define VL_CTRL DM320_REG2(0x0304) #define VL_STAT DM320_REG2(0x0308) #define VL_INTPRI DM320_REG2(0x030c) #define VL_INTST DM320_REG2(0x0310) #define VL_INTPND DM320_REG2(0x0314) #define VL_INTPTR DM320_REG2(0x0318) #define VL_TXMAP DM320_REG2(0x031c) #define VL_RXMAPSZ1 DM320_REG2(0x0320) #define VL_RXMAPOF1 DM320_REG2(0x0324) #define VL_RXMAPSZ2 DM320_REG2(0x0328) #define VL_RXMAPOF2 DM320_REG2(0x032c) #define VL_RXMAPSZ3 DM320_REG2(0x0330) #define VL_RXMAPOF3 DM320_REG2(0x0334) #define VL_RXMAPSZ4 DM320_REG2(0x0338) #define VL_RXMAPOF4 DM320_REG2(0x033c) #define VL_CHIPVER DM320_REG2(0x0340) #define VL_AUTONEG DM320_REG2(0x0344) #define VL_MANNEG DM320_REG2(0x0348) #define VL_NEGSTAT DM320_REG2(0x034c) #define VL_ENDIAN DM320_REG2(0x035c) #define VL_INTVEC30 DM320_REG2(0x0360) #define VL_INTVEC74 DM320_REG2(0x0364) #define VL_ID_R DM320_REG2(0x0380) #define VL_CTRL_R DM320_REG2(0x0384) #define VL_STAT_R DM320_REG2(0x0388) #define VL_INTPRI_R DM320_REG2(0x038c) #define VL_INTST_R DM320_REG2(0x0390) #define VL_INTPND_R DM320_REG2(0x0394) #define VL_INTPTR_R DM320_REG2(0x0398) #define VL_TXMAP_R DM320_REG2(0x039c) #define VL_RXMAPSZ1_R DM320_REG2(0x03a0) #define VL_RXMAPOF1_R DM320_REG2(0x03a4) #define VL_RXMAPSZ2_R DM320_REG2(0x03a8) #define VL_RXMAPOF2_R DM320_REG2(0x03ac) #define VL_RXMAPSZ3_R DM320_REG2(0x03b0) #define VL_RXMAPOF3_R DM320_REG2(0x03b4) #define VL_RXMAPSZ4_R DM320_REG2(0x03b8) #define VL_RXMAPOF4_R DM320_REG2(0x03bc) #define VL_CHIPVER_R DM320_REG2(0x03c0) #define VL_AUTONEG_R DM320_REG2(0x03c4) #define VL_MANNEG_R DM320_REG2(0x03c8) #define VL_NEGSTAT_R DM320_REG2(0x03cc) #define VL_ENDIAN_R DM320_REG2(0x03dc) #define VL_INTVEC30_R DM320_REG2(0x03e0) #define VL_INTVEC74_R DM320_REG2(0x03e4) /* Coprocessor Interface */ #define COP_SDEM_ADDRH DM320_COP(0xe000) #define COP_SDEM_ADDRL DM320_COP(0xe002) #define COP_SDEM_LOFST DM320_COP(0xe004) #define COP_BUF_ADDR DM320_COP(0xe006) #define COP_BUF_LOFST DM320_COP(0xe008) #define COP_DMA_XNUM DM320_COP(0xe00a) #define COP_DMA_YNUM DM320_COP(0xe00c) #define COP_DMA_CTRL DM320_COP(0xe00e) #define COP_BUF_MUX0 DM320_COP(0xe010) #define COP_BUF_MUX1 DM320_COP(0xe012) #define COP_IMG_MODE DM320_COP(0xe014) #define COP_CP_CLKC DM320_COP(0xe502) /* Taken from linux/include/asm-arm/arch-itdm320/irqs.h * * Copyright (C) 1999 ARM Limited * Copyright (C) 2004 Ingenient Technologies */ /* * Interrupt numbers */ #define IRQ_TIMER0 0 #define IRQ_TIMER1 1 #define IRQ_TIMER2 2 #define IRQ_TIMER3 3 #define IRQ_CCD_VD0 4 #define IRQ_CCD_VD1 5 #define IRQ_CCD_WEN 6 #define IRQ_VENC 7 #define IRQ_SERIAL0 8 #define IRQ_SERIAL1 9 #define IRQ_EXT_HOST 10 #define IRQ_DSPHINT 11 #define IRQ_UART0 12 #define IRQ_UART1 13 #define IRQ_USB_DMA 14 #define IRQ_USB_CORE 15 #define IRQ_VLYNQ 16 #define IRQ_MTC0 17 #define IRQ_MTC1 18 #define IRQ_SD_MMC 19 #define IRQ_SDIO_MS 20 #define IRQ_GIO0 21 #define IRQ_GIO1 22 #define IRQ_GIO2 23 #define IRQ_GIO3 24 #define IRQ_GIO4 25 #define IRQ_GIO5 26 #define IRQ_GIO6 27 #define IRQ_GIO7 28 #define IRQ_GIO8 29 #define IRQ_GIO9 30 #define IRQ_GIO10 31 #define IRQ_GIO11 32 #define IRQ_GIO12 33 #define IRQ_GIO13 34 #define IRQ_GIO14 35 #define IRQ_GIO15 36 #define IRQ_PREVIEW0 37 #define IRQ_PREVIEW1 38 #define IRQ_WATCHDOG 39 #define IRQ_I2C 40 #define IRQ_CLKC 41 /* Embedded Debugging Interrupts */ #define IRQ_ICE 42 #define IRQ_ARMCOM_RX 43 #define IRQ_ARMCOM_TX 44 #define IRQ_RESERVED 45 #define NR_IRQS 46 /* Taken from linux/include/asm-arm/arch-integrator/timex.h * * Copyright (C) 1999 ARM Limited */ #define CONFIG_TIMER0_TMMD_STOP 0x0000 #define CONFIG_TIMER0_TMMD_ONE_SHOT 0x0001 #define CONFIG_TIMER0_TMMD_FREE_RUN 0x0002 #define CONFIG_TIMER1_TMMD_STOP 0x0000 #define CONFIG_TIMER1_TMMD_ONE_SHOT 0x0001 #define CONFIG_TIMER1_TMMD_FREE_RUN 0x0002 #define CONFIG_TIMER2_TMMD_STOP 0x0000 #define CONFIG_TIMER2_TMMD_ONE_SHOT 0x0001 #define CONFIG_TIMER2_TMMD_FREE_RUN 0x0002 #define CONFIG_TIMER2_TMMD_CCD_SHUTTER 0x0100 #define CONFIG_TIMER2_TMMD_CCD_STROBE 0x0200 #define CONFIG_TIMER2_TMMD_POLARITY 0x0400 #define CONFIG_TIMER2_TMMD_TRG_SELECT 0x0800 #define CONFIG_TIMER2_TMMD_TRG_READY 0x1000 #define CONFIG_TIMER2_TMMD_SIGNAL 0x2000 #define CONFIG_TIMER3_TMMD_STOP 0x0000 #define CONFIG_TIMER3_TMMD_ONE_SHOT 0x0001 #define CONFIG_TIMER3_TMMD_FREE_RUN 0x0002 #define CONFIG_TIMER3_TMMD_CCD_SHUTTER 0x0100 #define CONFIG_TIMER3_TMMD_CCD_STROBE 0x0200 #define CONFIG_TIMER3_TMMD_POLARITY 0x0400 #define CONFIG_TIMER3_TMMD_TRG_SELECT 0x0800 #define CONFIG_TIMER3_TMMD_TRG_READY 0x1000 #define CONFIG_TIMER3_TMMD_SIGNAL 0x2000 /* * IO_MODx bits */ #define CLK_MOD0_HPIB (1 << 11) #define CLK_MOD0_DSP (1 << 10) #define CLK_MOD0_EXTHOST (1 << 9) #define CLK_MOD0_SDRAMC (1 << 8) #define CLK_MOD0_EMIF (1 << 7) #define CLK_MOD0_INTC (1 << 6) #define CLK_MOD0_AIM (1 << 5) #define CLK_MOD0_E2ICE (1 << 4) #define CLK_MOD0_ETM (1 << 3) #define CLK_MOD0_AHB (1 << 2) #define CLK_MOD0_BUSC (1 << 1) #define CLK_MOD0_ARM (1 << 0) #define CLK_MOD1_CPBUS (1 << 11) #define CLK_MOD1_SEQ (1 << 10) #define CLK_MOD1_DCT (1 << 9) #define CLK_MOD1_IMGBUF (1 << 8) #define CLK_MOD1_IMX (1 << 7) #define CLK_MOD1_VLCD (1 << 6) #define CLK_MOD1_DAC (1 << 5) #define CLK_MOD1_VENC (1 << 4) #define CLK_MOD1_OSD (1 << 3) #define CLK_MOD1_PRV (1 << 2) #define CLK_MOD1_H3A (1 << 1) #define CLK_MOD1_CCDC (1 << 0) #define CLK_MOD2_TEST (1 << 15) #define CLK_MOD2_MS (1 << 14) #define CLK_MOD2_VLYNQ (1 << 13) #define CLK_MOD2_I2C (1 << 12) #define CLK_MOD2_MMC (1 << 11) #define CLK_MOD2_SIF1 (1 << 10) #define CLK_MOD2_SIF0 (1 << 9) #define CLK_MOD2_UART1 (1 << 8) #define CLK_MOD2_UART0 (1 << 7) #define CLK_MOD2_USB (1 << 6) #define CLK_MOD2_GIO (1 << 5) #define CLK_MOD2_CCDTMR1 (1 << 4) #define CLK_MOD2_CCDTMR0 (1 << 3) #define CLK_MOD2_TMR1 (1 << 2) #define CLK_MOD2_TMR0 (1 << 1) #define CLK_MOD2_WDT (1 << 0) #define CLK_SEL0_UART0 (1 << 5) #define CLK_SEL1_OSD (1 << 12) #define CLK_SEL1_CCD (1 << 8) #define CLK_SEL1_VENCPLL (1 << 4) #define CLK_SEL1_VENC(x) (x << 0) #define CLK_OSEL_O2SEL(x) (x << 8) #define CLK_OSEL_O1SEL(x) (x << 4) #define CLK_OSEL_O0SEL(x) (x << 0) #define CLK_BYP_AXL (1 << 12) #define CLK_BYP_SDRAM (1 << 8) #define CLK_BYP_DSP (1 << 4) #define CLK_BYP_ARM (1 << 0) #define CLK_INV_MMC (1 << 0) #define CLK_INV_VENC (1 << 4) #define CLK_INV_CCD (1 << 8) #define CLK_INV_SIF0 (1 << 12) #define CLK_INV_SIF1 (1 << 13) #define MMC_CTRL_DATRST (1 << 0) #define MMC_CTRL_CMDRST (1 << 1) #define MMC_CTRL_WIDTH (1 << 2) #define MMC_CTRL_DMASZEN (1 << 4) #define MMC_CTRL_TEST2 (1 << 8) #define MMC_CTRL_PERMDR (1 << 9) #define MMC_CTRL_PERMDX (1 << 10) #define MMC_CMD_CMD_MASK (0x3F) #define MMC_CMD_PPLEN (1 << 7) #define MMC_CMD_BSYEXP (1 << 8) #define MMC_CMD_RSPFMT_SHIFT 9 #define MMC_CMD_RSPFMT_MASK (3 << MMC_CMD_RSPFMT_SHIFT) #define MMC_CMD_WRITE (1 << 11) #define MMC_CMD_STREAM (1 << 12) #define MMC_CMD_DATA (1 << 13) #define MMC_CMD_INITCLK (1 << 14) #define MMC_CMD_DCLR (1 << 15) #define MMC_ST0_DATDNE (1 << 0) #define MMC_ST0_BSYDNE (1 << 1) #define MMC_ST0_RSPDNE (1 << 2) #define MMC_ST0_DATA_TIMEOUT (1 << 3) #define MMC_ST0_CMD_TIMEOUT (1 << 4) #define MMC_ST0_WR_CRCERR (1 << 5) #define MMC_ST0_RD_CRCERR (1 << 6) #define MMC_ST0_RESP_CRCERR (1 << 7) #define MMC_ST0_DMADNE (1 << 8) #define MMC_ST0_DXRDY (1 << 9) #define MMC_ST0_DRRDY (1 << 10) #define MMC_ST0_DAT3_EDGE (1 << 11) #define MMC_ST1_BUSY (1 << 0) #define MMC_ST1_CLKSTP (1 << 1) #define MMC_ST1_DXEMPTY (1 << 2) #define MMC_ST1_DXFULL (1 << 3) #define MMC_ST1_DAT3ST (1 << 4) #define MMC_IE_EDATDNE (1 << 0) #define MMC_IE_EBSYDNE (1 << 1) #define MMC_IE_ERSPDNE (1 << 2) #define MMC_IE_ETOUTRD (1 << 3) #define MMC_IE_ETOUTRS (1 << 4) #define MMC_IE_ECRCWR (1 << 5) #define MMC_IE_ECRCRD (1 << 6) #define MMC_IE_ECRCRS (1 << 7) #define MMC_IE_EDXRDY (1 << 9) #define MMC_IE_EDRRDY (1 << 10) #define MMC_IE_EDATED (1 << 11) #define MMC_DMAMODE_RD_WORDSWAP (1 << 10) #define MMC_DMAMODE_WR_WORDSWAP (1 << 11) #define MMC_DMAMODE_WRITE (1 << 12) #define MMC_DMAMODE_ENABLE (1 << 13) #define MMC_DMAMODE_TIMEOUTIRQ_EN (1 << 14) #define MMC_DMASTAT1_RUNST (1 << 12) #define MMC_DMASTAT1_TOUTDT (1 << 13) /* * IO_EINTx bits */ #define INTR_EINT0_USB1 (1 << 15) #define INTR_EINT0_USB0 (1 << 14) #define INTR_EINT0_UART1 (1 << 13) #define INTR_EINT0_UART0 (1 << 12) #define INTR_EINT0_IMGBUF (1 << 11) #define INTR_EINT0_EXTHOST (1 << 10) #define INTR_EINT0_SP1 (1 << 9) #define INTR_EINT0_SP0 (1 << 8) #define INTR_EINT0_VENC (1 << 7) #define INTR_EINT0_CCDWEN (1 << 6) #define INTR_EINT0_CCDVD1 (1 << 5) #define INTR_EINT0_CCDVD0 (1 << 4) #define INTR_EINT0_TMR3 (1 << 3) #define INTR_EINT0_TMR2 (1 << 2) #define INTR_EINT0_TMR1 (1 << 1) #define INTR_EINT0_TMR0 (1 << 0) #define INTR_EINT1_EXT10 (1 << 15) #define INTR_EINT1_EXT9 (1 << 14) #define INTR_EINT1_EXT8 (1 << 13) #define INTR_EINT1_EXT7 (1 << 12) #define INTR_EINT1_EXT6 (1 << 11) #define INTR_EINT1_EXT5 (1 << 10) #define INTR_EINT1_EXT4 (1 << 9) #define INTR_EINT1_EXT3 (1 << 8) #define INTR_EINT1_EXT2 (1 << 7) #define INTR_EINT1_EXT1 (1 << 6) #define INTR_EINT1_EXT0 (1 << 5) #define INTR_EINT1_MMCSDMS1 (1 << 4) #define INTR_EINT1_MMCSDMS0 (1 << 3) #define INTR_EINT1_MTC1 (1 << 2) #define INTR_EINT1_MTC0 (1 << 1) #define INTR_EINT1_VLYNQ (1 << 0) #define INTR_EINT2_RSVINT (1 << 13) #define INTR_EINT2_ARMCOMTX (1 << 12) #define INTR_EINT2_ARMCOMRX (1 << 11) #define INTR_EINT2_E2ICE (1 << 10) #define INTR_EINT2_INTRC (1 << 9) #define INTR_EINT2_I2C (1 << 8) #define INTR_EINT2_WDT (1 << 7) #define INTR_EINT2_PREV1 (1 << 6) #define INTR_EINT2_PREV0 (1 << 5) #define INTR_EINT2_EXT15 (1 << 4) #define INTR_EINT2_EXT14 (1 << 3) #define INTR_EINT2_EXT13 (1 << 2) #define INTR_EINT2_EXT12 (1 << 1) #define INTR_EINT2_EXT11 (1 << 0) /* * IO_IRQx bits */ #define INTR_IRQ0_TMR0 INTR_EINT0_TMR0 #define INTR_IRQ0_TMR1 INTR_EINT0_TMR1 #define INTR_IRQ0_TMR2 INTR_EINT0_TMR2 #define INTR_IRQ0_TMR3 INTR_EINT0_TMR3 #define INTR_IRQ0_UART1 INTR_EINT0_UART1 #define INTR_IRQ0_CCDVD1 INTR_EINT0_CCDVD1 #define INTR_IRQ0_IMGBUF INTR_EINT0_IMGBUF #define INTR_IRQ1_EXT0 INTR_EINT1_EXT0 #define INTR_IRQ1_EXT2 INTR_EINT1_EXT2 #define INTR_IRQ1_EXT7 INTR_EINT1_EXT7 #define INTR_IRQ1_MMCSDMS0 INTR_EINT1_MMCSDMS0 #define INTR_IRQ1_MTC0 INTR_EINT1_MTC0 /* * HPIBCTL bits */ #define HPIBCTL_DBIO (1 << 10) #define HPIBCTL_DHOLD (1 << 9) #define HPIBCTL_DRST (1 << 8) #define HPIBCTL_DINT0 (1 << 7) #define HPIBCTL_EXCHG (1 << 5) #define HPIBCTL_HPNMI (1 << 3) #define HPIBCTL_HPIEN (1 << 0) /* * Video Encoder bits */ #define VENC_VMOD_VDMD(x) (x << 12) #define VENC_VMOD_ITLC (1 << 10) #define VENC_VMOD_CBTYP (1 << 9) #define VENC_VMOD_CBMD (1 << 8) #define VENC_VMOD_NTPLS(x) (x << 6) #define VENC_VMOD_SLAVE (1 << 5) #define VENC_VMOD_VMD (1 << 4) #define VENC_VMOD_BLNK (1 << 3) #define VENC_VMOD_DACPD (1 << 2) #define VENC_VMOD_VIE (1 << 1) #define VENC_VMOD_VENC (1 << 0) #define VENC_VDCTL_VCLKP (1 << 14) #define VENC_VDCTL_VCLKE (1 << 13) #define VENC_VDCTL_VCLKZ (1 << 12) #define VENC_VDCTL_DOMD(x) (x << 4) #define VENC_VDCTL_YCDC (1 << 2) #define VENC_VDCTL_INPTRU (1 << 1) #define VENC_VDCTL_YCDIR (1 << 0) #define VENC_VDPRO_PFLTY(x) (x << 12) #define VENC_VDPRO_PFLTR (1 << 11) #define VENC_VDPRO_YCDLY(x) (x << 8) #define VENC_VDPRO_RGBMAT (1 << 7) #define VENC_VDPRO_ATRGB (1 << 6) #define VENC_VDPRO_ATYCC (1 << 5) #define VENC_VDPRO_ATCOM (1 << 4) #define VENC_VDPRO_STUP (1 << 3) #define VENC_VDPRO_CRCUT (1 << 2) #define VENC_VDPRO_CUPS (1 << 1) #define VENC_VDPRO_YUPS (1 << 0) #define VENC_SYNCTL_EXFEN (1 << 12) #define VENC_SYNCTL_EXFIV (1 << 11) #define VENC_SYNCTL_EXSYNC (1 << 10) #define VENC_SYNCTL_EXVIV (1 << 9) #define VENC_SYNCTL_EXHIV (1 << 8) #define VENC_SYNCTL_CSP (1 << 7) #define VENC_SYNCTL_CSE (1 << 6) #define VENC_SYNCTL_SYSW (1 << 5) #define VENC_SYNCTL_VSYNCS (1 << 4) #define VENC_SYNCTL_VPL (1 << 3) #define VENC_SYNCTL_HPL (1 << 2) #define VENC_SYNCTL_SYE (1 << 1) #define VENC_SYNCTL_SYDIR (1 << 0) #define VENC_RGBCTL_IRONM (1 << 11) #define VENC_RGBCTL_DFLTR (1 << 10) #define VENC_RGBCTL_DFLTS(x) (x << 8) #define VENC_RGBCTL_RGBEF(x) (x << 4) #define VENC_RGBCTL_RGBOF(x) (x << 0) #define VENC_RGBCLP_UCLIP(x) (x << 8) #define VENC_RGBCLP_OFST(x) (x << 0) #define VENC_LCDOUT_FIDS (1 << 8) #define VENC_LCDOUT_FIDP (1 << 7) #define VENC_LCDOUT_PWMP (1 << 6) #define VENC_LCDOUT_PWME (1 << 5) #define VENC_LCDOUT_ACE (1 << 4) #define VENC_LCDOUT_BRP (1 << 3) #define VENC_LCDOUT_BRE (1 << 2) #define VENC_LCDOUT_OEP (1 << 1) #define VENC_LCDOUT_OEE (1 << 0) #define VENC_DCLKCTL_DOFST(x) (x << 12) #define VENC_DCLKCTL_DCKEC (1 << 11) #define VENC_DCLKCTL_DCKME (1 << 10) #define VENC_DCLKCTL_DCKOH (1 << 9) #define VENC_DCLKCTL_DCKIH (1 << 8) #define VENC_DCLKCTL_DCKPW(x) (x << 0) /* Timer frequency */ /* timer is based on PCLK and minimum division is 2 */ #define TIMER_FREQ (27000000) #endif